74ls86n功能（74ls86d）

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（请在此处插入74LS74的引脚图）功能详解：（1）D端（数据输入端）：这是触发器的数据输入端，当CP端（时钟脉冲端）上升沿到来时，D端的数据被传输到Q端（数据输出端）。

在ttl电路中，比较典型的d触发电路有74ls74。74ls74是边缘触发数字电路设备，每个设备包括两个相同、独立的边缘触发d触发电路模块。d触发器的次级状态取决于触发前d端的状态，即次级状态=D。因此，它具有0、置1两种功能。

LS74 74为2个D触发器，1脚为第一个触发器的复位端低电平有效，2脚为D1，3脚为第一个触发器的时钟CP1，4脚为第一个触发器的置位端低电平有效，5脚为Q1，6脚为Q1\，7脚接地GND。

LS74是一个双D触发器，可以用来设计二位二进制加法计数器。二进制加法计数设计如下：原理：74LS74为双D触发器，即带有两个D触发器，令其各为一个计数器，再将其串联即可形成一个加法金属器。

LS74这个集成块是一个双D触发器，其功能比较的多，可用作寄存器，移位寄存器，振荡器，单稳态，分频计数器等功能。除此之外，像数字电路总的集成块的用途都是相当的多，根据情况灵活的运用。

LS74是一个D触发器，触发器具有两个稳定状态，即0和1，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。分频用同一个时钟信号通过一定的电路结构转变成不同频率的时钟信号。

LS74是一个双D触发器芯片，共有14个引脚。其主要功能是在时钟脉冲的控制下，实现数据的存储和传输。详细引脚图：74LS74的引脚图如下，其中，每个引脚都有其特定的功能。

LS74系列设备包含两个独立的D型正边触发触发器，引脚图及功能详解如下：在ttl电路中，比较典型的d触发电路有74ls74。74ls74是边缘触发数字电路设备，每个设备包括两个相同、独立的边缘触发d触发电路模块。

1、驱动能力不同，LS一般高电平的驱动能力为5mA，低电平为20mA；而CMOS的高低电平均为5mA； CMOS器件抗静电能力差，易发生栓锁问题，所以CMOS的输入脚不能直接接电源。

2、芎卜门）， 74LS08 （⊥弓门）， 74LS32 （厦戈门），74LS86（异或门）的外部引脚参看附录“部分集成电路引脚图”中的内容。

3、LS377N是八D触发器。 74LS393N是双四位二进制计数器。 74LS86AN是二输入端四异门。资料在 21ic.com 网，在器件搜索，把型号添上，一搜就来了。

4、非门实现逻辑代数非的功能，即输出始终和输入保持相反。与非门若当输入均为高电平1，则输出为低电平0；若输入中至少有一个为低电平0，则输出为高电平1。与非门可以看作是与门和非门的叠加。

ls86是逻辑门。逻辑门（LogicGates）是在集成电路（IntegratedCircuit）上的基本组件。简单的逻辑门可由晶体管组成。这些晶体管的组合可以使代表两种信号的高低电平在通过它们之后产生高电平或者低电平的信号。

hc86n是高速Cmos电路，该电路是二输入端四异或门。采用双列直插14脚封装，1脚2脚是第一个异或门的输入端，3脚是它的输出端。其它三个异或门分别是4，5，6脚，9，10，8脚和13，12，11脚，Vcc是14脚，Gnd第7脚。

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