jk触发器sdrd的功能（jk触发器中sd和rd）

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sd和rd连接到基本rs触发器的输入端。它们分别被预设和重置。低水平是有效的。

SD和RD接至基本RS触发器的输入端，它们分别是预置和清零端，低电平有效。

在1时，这两个端子是低电平有效的。RD设置为0，SD设置为1。在正常操作中，它们都应该是1，RD=0，输出Q=0，SD=0，输出Q=1。

1、翻转功能。当输入时钟信号时，JK触发器能够在特定条件下翻转位状态，即从0到1或从1到0。同步功能。JK触发器能够在输入时钟信号的作用下同步输入的数据，因此可以在特定时钟下实现同步操作。控制功能。

2、JK触发器具有置0、置保持和翻转功能，在各类集成触发器中，JK触发器的功能最为齐全。在实际应用中，它不仅有很强的通用性，而且能灵活地转换其他类型的触发器。

3、输出q=1。可以利用这两个端来进行联片，当符号上有非号时，信号是低电平有效，没有非号时，是高电平有效，使用时，总是使得触发器置位端无效，触发器才能正常使用，可以用别的信号加在这两个端上来控制触发器。

4、JK触发器是数字电路触发器中的一种基本电路单元。JK触发器具有置0、置保持和翻转等功能，它可以视为D触发器和翻转触发器的组合。

1、LS112 112是2JK触发器，第一引脚是第一个触发器的时钟脉冲CP1，2脚是K1，3脚是J1，4脚是置位端，低电平有效（即4脚为低时输出位高），5脚为Q1，6脚为Q1\，7脚为第二个触发器的反输出Q2\。

2、HD74LS112是日本日立公司生产的一种逻辑芯片，其功能是实现J-K触发器。它是一种三态触发器，具有J，K，Clear，Set四个输入端和Q，Q两个输出端。

3、当计数为3时，输出状态为11，利用11这个状态产生一个复位信号，使两个触发器复位回0，就不会出现计数的3了，最大数是2，即为要求的3进制计数器了。逻辑图（也即仿真图）如下，图中JK触发器是74LS112。

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