74引脚图及功能表（74ls74引脚图及功能表）

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③若将选通端中的一个作为数据输入端时，74LS138还可作数据分配器。④可用在8086的译码电路中，扩展内存。

若将选通端中的一个作为数据输入端时，74LS138还可作数据分配器。可用在8086的译码电路中，扩展内存。

ls138引脚图74HC138管脚图：74LS138为3线，8线译码器，共有54/74S138和54/74LS138两种线路结构型式。

G2A、G2B、G1，输入使能端，用于选择芯片内部不同的逻辑功能。A、B、C，三个地址输入端，共有8种不同的组合方式。Y0~Y7，八个输出端，其中一个会被选中，高电平输出。

ls153的逻辑功能是实现数据选择功能，即把多路数据中的某一路数据传送到公共数据线上，其作用相当于多个输入的单刀多掷开关。74ls153是双4选一数据选择器。

ls151引脚图及功能：数据选择器74LS151D的引脚~G的作用是使能控制输入脚，如下图，可以理解为选片端。当两片级联使用组成16选1时，就由G脚实现选片，选前8个数据输入时，第一片的G=0有效，被选中。

数据选择器74LS151D的引脚~G的作用是使能控制输入脚，如下图，可以理解为选片端。当两片级联使用组成16选1时，就由G脚实现选片，选前8个数据输入时，第一片的G=0有效，被选中。LS151和74HC151都是8选1数据选择器。

是数据选择器，又称波段开关，一个两位以上输出的数据选择器相当一个多刀多掷波段开关，它用于从8个数据中选择一个数据输出。

1、ls76是双J-K触发器，如果置1端或置0端始终为0，其正向输出端Q或反向输出端Q则会终为1，不再翻转，即失去了计数的功能，当然也就失去了在电路中应有的作用。

2、LS112 112是2JK触发器，第一引脚是第一个触发器的时钟脉冲CP1，2脚是K1，3脚是J1，4脚是置位端，低电平有效（即4脚为低时输出位高），5脚为Q1，6脚为Q1\，7脚为第二个触发器的反输出Q2\。

3、本实验采用74LS112(或74LS76)双JK触发器，是下降边沿触发的边沿触发器。引脚功能及逻辑符号如图1-1所示。

4、LS74是一个双D触发器，可以用来设计二位二进制加法计数器。二进制加法计数设计如下：原理：74LS74为双D触发器，即带有两个D触发器，令其各为一个计数器，再将其串联即可形成一个加法金属器。

1、ls161引脚图：74ls161功能：从功能表中能够知道，如果清零端CR=“0”时，计数器输出QQQQ0都会马上为全“0”，这个时候是异步复位功能。

2、LS161是一个同步的可预置的四位二进制计数器，并自带有异步功能。可以采用反馈归零法进行6进制的计数器设计。用74LS160设计任意进制计数器：74LS160是十进制同步加法器计数器。同步由时钟信号的清除和设置控制。

3、LS161是四位二进制同步加法计数器，使用该计数器实现十二进制计数器主要有置数法和清零法两种方法。

4、LS161是4位二进制同步加法计数器，除了有二进制加法计数功能外，还具有异步清零、同步并行置数、保持等功能。

5、LS161是常用的四位二进制可预置的同步加法计数器，他可以灵活的运用在各种数字电路，以及单片机系统种实现分频器等很多重要的功能。

6、要想实现就有两种方法，置零或置数，我用置零法来试试，因为74LS161是有异步置零端，所以需要到0111这个状态后再置零，因为0111这个状态时间很短所以不会进入有效状态。

1、②利用 EE2和E3可级联扩展成 24 线译码器；若外接一个反相器还可级联扩展成 32 线译码器。③若将选通端中的一个作为数据输入端时，74LS138还可作数据分配器。④可用在8086的译码电路中，扩展内存。

2、ls138引脚图74HC138管脚图：74LS138为3线，8线译码器，共有54/74S138和54/74LS138两种线路结构型式。

3、根据查询得知。引脚图：首先用与非门组成的3线-8线译码器74LS138。其次3线-8线译码器74LS138的功能表。最后74ls138逻辑符号逻辑图还是功能表打开即可。

4、LS138译码器得引脚图，逻辑图及功能表如下 74LS138的引脚图用与非门组成71LS138有三个附加的控制端、和。

5、-12-18 写出如图所示逻辑图的逻辑函数表达式。

6、因此，译码与显示驱动电路可用74LS138(其功能表如表3所示)、6个与非门和6个反相器构成，逻辑电路如图10中的(Ⅰ)所示。图中，译码器74LS138的输入端C、B、A分别接KQQ0。

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